机读格式显示(MARC)
- 010 __ |a 7-5053-6912-1 |d CNY28.00
- 100 __ |a 20030925d2002 ekmy0chiy0121 ea
- 200 1_ |a 数字系统设计与Verilog HDL |A shu zi xi tong she ji yuV erilog HDL |f 王金明, 杨吉斌编著
- 210 __ |a 北京 |c 电子工业出版社 |d 2002 |h 2003年第3次印刷
- 215 __ |a 304页 |c 图 |d 26cm
- 410 _0 |1 2001 |a EDA工具应用丛书
- 606 0_ |a 硬件描述语言 |x 计算机辅助设计
- 701 _0 |a 杨吉斌 |A yang ji bin |4 编著
- 701 _0 |a 王金明 |A wang jin ming |4 编著
- 801 _0 |a CN |b CAU |c 20040103
- 905 __ |a CAU |d TP312/894
- 907 __ |a CAU |f TP312/894
- 999 __ |t C |A zj |a 20030925 10:11:14 |I zxww |i 20040103 15:25:53 |G zxww |g 20040103 15:26:0