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• 010 __ |a 978-7-121-12021-3 |d CNY29.00

• 099 __ |a CAL 012011025241

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• 106 __ |a r

• 200 1_ |a Verilog HDL数字系统设计及实践 |A verilog hdl shu zi xi tong she ji ji shi jian |f 刘睿强, 童贞理, 尹洪剑编著

• 210 __ |a 北京 |c 电子工业出版社 |d 2011

• 215 __ |a 213页 |c 图 |d 26cm

• 225 2_ |a 新编电气与电子信息类规划教材 |A xin bian dian qi yu dian zi xin xi lei gui hua jiao cai

• 320 __ |a 有书目

• 330 __ |a 本书介绍Verilog HDL硬件描述语言及电路设计方法，共11章，主要内容包括：Verilog层次化设计、Verilog基本语法、Verilog行为描述、组合逻辑建模、时序逻辑建模、为级仿真模型建模、各层次Verilog描述形式与电路建模、任务和函数、编译预处理、Verilog设计与综合中的陷阱、异步设计与同步设计的时序分析。本书配套实验，提供电子课件和习题参考答案。

• 410 _0 |1 2001 |a 新编电气与电子信息类规划教材

• 606 0_ |a VHDL语言 |A vhdl yu yan |x 程序设计 |j 教材

• 690 __ |a TP312VH |v 4

• 690 __ |a TP312 |v 4

• 701 _0 |a 刘睿强 |A liu rui qiang |4 编著

• 701 _0 |a 童贞理 |A tong zhen li |4 编著

• 701 _0 |a 尹洪剑 |A yin hong jian |4 编著

• 801 _0 |a CN |b CAU |c 20111228

• 905 __ |a CAU |d TP312/2718

• 920 __ |a 211180 |z 1