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• 010 __ |a 978-7-121-43907-0 |d CNY119.00

• 099 __ |a CAL 012022092925

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• 101 1_ |a chi |c eng

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• 106 __ |a r

• 200 1_ |a 数字设计 |A shu zi she ji |e Verilog HDL、VHDL和SystemVerilog实现 |d = Digital design |e with an introduction to the Verilog HDL, VHDL, and SystemVerilog |f (美) M. Morris Mano, Michael D. Ciletti著 |g 尹廷辉, 薛红, 倪雪译 |z eng

• 205 __ |a 第4版

• 210 __ |a 北京 |c 电子工业出版社 |d 2022

• 215 __ |a 12, 509页 |c 图 |d 26cm

• 225 2_ |a 国外电子与通信教材系列 |A guo wai dian zi yu tong xin jiao cai xi lie

• 300 __ |a 国外电子通信教材

• 305 __ |a 据原书第6版译出

• 306 __ |a Pearson Education (培生教育出版集团) 授权出版

• 314 __ |a 责任者Mano规范汉译姓: 马诺; 责任者Ciletti规范汉译姓: 奇莱蒂

• 320 __ |a 有书目

• 330 __ |a 本书共10章，内容涉及数字逻辑的基本理论，组合逻辑电路，时序逻辑电路，寄存器和计数器，存储器和可编程逻辑器件，寄存器传输级设计，半导体和CMOS集成电路，标准IC和FPGA实验，标准图形符号，Verilog HDL、VHDL、SystemVerilog与数字系统设计等，旨在教会读者关于数字设计的基本概念和基本方法。

• 410 _0 |1 2001 |a 国外电子与通信教材系列

• 500 10 |a Digital design: with an introduction to the Verilog HDL, VHDL, and SystemVerilog |A Digital Design: With An Introduction To The Verilog Hdl, Vhdl, And Systemverilog |m Chinese

• 517 1_ |a Verilog HDL、VHDL和SystemVerilog实现 |A Verilog HDL 、 VHDL he SystemVerilog shi xian

• 606 0_ |a 数字电路 |A shu zi dian lu |x 电路设计 |j 教材

• 690 __ |a TN79 |v 5

• 701 _1 |a 马诺 |A ma nuo |g (Mano, M. Morris), |f 1927- |4 著

• 701 _1 |a 奇莱蒂 |A qi lai di |g (Ciletti, Michael D.) |4 著

• 702 _0 |a 尹廷辉 |A yin ting hui |4 译

• 702 _0 |a 薛红 |A xue hong |4 译

• 702 _0 |a 倪雪 |A ni xue |4 译

• 801 _0 |a CN |b CAU |c 20240314

• 905 __ |a CAU |d TN79/141(4)

• 920 __ |a 211180 |z 1